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        賽靈思公司專利技術

        賽靈思公司共有386項專利

        • 一種電路布置包含MAC電路(200
        • 本公開的實施例涉及統(tǒng)一的可編程計算存儲器和配置網絡。示例總體上涉及具有統(tǒng)一的可編程計算存儲器(PCM)和配置網絡的可編程設備。在一個示例中,一種可編程設備包括管芯,該管芯包括具有PCM區(qū)塊的PCM集成電路。PCM區(qū)塊包括配置存儲器(CM...
        • 提供一種方法和裝置,其包括具有芯片內散熱器112的集成電路管芯114、116和同樣具有這些芯片內散熱器112的電子器件和芯片封裝以及其制造方法。在一個示例中,集成電路管芯114、116具有芯片內散熱器112,該芯片內散熱器112將高發(fā)熱...
        • 一種示例可編程集成電路(IC),包括處理系統(tǒng)(2),該處理系統(tǒng)(2)具有處理器(5)、主機電路(404)、以及系統(tǒng)存儲器管理單元(SMMU)(80)。該SMMU包括第一轉換緩沖器單元(TBU)(410),其耦合到主機電路;地址轉換(AT...
        • 一種電路布置,包括設置在片上系統(tǒng)(SoC)(102)上并被配置為接收和存儲流式調試包的一個或多個輸入緩沖器(312、314,
        • 本公開涉及增強型本地布線和時鐘改進的可配置邏輯塊內部布線架構。一種系統(tǒng)包括彼此相鄰放置的一對可配置邏輯塊(CLB),其中每個CLB包括多個可配置邏輯元件。多組inode被配置為接受去往和/或來自CLB的信號,其中第一組inode位于相鄰...
        • 本公開的實施例涉及芯片封裝組件和高帶寬存儲器芯片封裝組件。提供了一種芯片封裝組件,其利用多個管芯外傳熱柱來改善熱管理。在一個示例中,提供了一種芯片封裝組件,該芯片封裝組件包括第一集成電路(IC)管芯,其被安裝到基板;蓋子,其被設置在第一...
        • 一種示例性∑?Δ調制器(SDM)電路包括向下取整電路(306)、具有被耦接到向下取整電路的輸入的第一輸入和被耦接到向下取整電路的輸出的第二輸入的減法器(308)、以及具有可編程次序的多級噪聲整形(MASH)轉換器(302)。MASH轉換...
        • 集成電路IC[150]可以包括用于硬件加速的調度器[160]。調度器可以包括命令隊列[165],所述命令隊列具有多個槽并且被配置為存儲從主處理器[105]卸載的命令,以由IC[150]的計算單元執(zhí)行。調度器[160]可以包括狀態(tài)寄存器[...
        • 本實用新型涉及集成電路裝置。集成電路裝置包括至少一個具有ESD保護電路系統(tǒng)的非I/O裸片。本文公開的ESD保護電路系統(tǒng)也可以被用于I/O裸片中。在一個示例中,集成電路裝置包括具有第一主體的裸片。第一接觸墊和第二接觸墊暴露于第一主體的表面...
        • 公開的電路包括RAM電路(404、406)、存儲器控制器(402)和處理電路陣列(408、410)。每個RAM電路包括讀取端口和寫入端口。存儲器控制器訪問布置在RAM電路中的張量緩沖器(412、414、416、418)的組中的張量數據。...
        • 一種設備可以包括多個數據處理引擎[304]、子系統(tǒng)[106,312,504,508]、以及耦合到多個數據處理引擎[304]和子系統(tǒng)[106,312,504,508]的SoC接口塊[104]。SoC接口塊[104]可以被配置為在子系統(tǒng)[1...
        • 描述了一種用于在集成電路中接收信號的電路。該電路包括采樣器(202)、時鐘和數據恢復電路(204)以及相位插值器(206),采樣器(202)被配置為接收輸入數據信號,其中采樣器生成采樣數據和恢復時鐘;時鐘和數據恢復電路(204)被配置為...
        • 裝置可以包括多個數據處理引擎(304)。每個數據處理引擎(304)可以包括核心(602)和存儲器模塊(604)。每個核心(602)可以被配置成訪問相同數據處理引擎[304]中的存儲器模塊(604)和多個數據處理引擎(304)中的至少一個...
        • 異構片上系統(tǒng)(SoC)[200]中的多域創(chuàng)建和隔離可以包括接收[705]硬件描述文件[135、505],所述硬件描述文件指定異構SoC[200]中可用的多個處理器[206、208、210]和多個硬件資源,并使用計算機硬件為異構SoC[2...
        • 一種用于集成電路(IC)中的數據處理引擎(DPE)陣列(105)的示例DPE(110),包括核(202);存儲器(204),其包括數據存儲器(208)和程序存儲器(206),該程序存儲器耦合到核,該數據存儲器耦合到核并且包括與DPE外部...
        • 時滯調整電路(800)包括用于從交錯ADC(210)的多個通道(CH1?CH4)接收輸入信號(201)的一系列采樣(V(t))的輸入。第一減法器(802)計算所接收的一系列采樣(V(t))中連續(xù)采樣(V(t)和V(t+1))之間的距離(...
        • 一種設備可以包括多個數據處理引擎[304]。數據處理引擎[304]中的每個數據處理引擎[304]可以包括核心[602]和存儲器模塊[604]。多個數據處理引擎[304]可以被組織在多個行中。每個核心可以被配置為通過對多個數據處理引擎[3...
        • 一種示例時間偏斜校準電路包括多個第一電路(702),每個第一電路包括第一累加器(720)和第二累加器(722)。時間偏斜校準電路還包括多個第二電路(704),每個第二電路包括耦合到第一累加器和第二累加器的輸出的第一加法器(724)、以及...
        • 本文中描述了FinFET晶體管(102)、(104)、PN結(150)及其形成方法(400)。在一個示例中,描述了一種FinFET晶體管(102、104),該FinFET晶體管(102、104)包括金屬柵極(208)所包裹的溝道區(qū)域(2...